[論文レビュー] An Architecture for Improved Surface Code Connectivity in Neutral Atoms
本論文は、中性原子量子コンピュータ向けに共同設計されたサーフェスコードアーキテクチャを提案し、論理的キュービットのインターリーブドグループを用いて、グループ内でのすべてのキュービット間接続を高速なトレーラスラルCNOTゲートで実現することで、論理的誤り率を低減し、ルーティング用アーキテクチャを不要にしている。大規模回路では、グループ間での高接続性ルーティングを可能にするインターリーブドラティスソークを導入し、標準的なラティスソークと比較して2倍〜5倍の高速化を達成しており、約50キュービットのクロスオーバー点で原子移動からラティスソークへの移行が最適なパフォーマンスを示すことを明らかにしている。
In order to achieve error rates necessary for advantageous quantum algorithms, Quantum Error Correction (QEC) will need to be employed, improving logical qubit fidelity beyond what can be achieved physically. As today's devices begin to scale, co-designing architectures for QEC with the underlying hardware will be necessary to reduce the daunting overheads and accelerate the realization of practical quantum computing. In this work, we focus on logical computation in QEC. We address quantum computers made from neutral atom arrays to design a surface code architecture that translates the hardware's higher physical connectivity into a higher logical connectivity. We propose groups of interleaved logical qubits, gaining all-to-all connectivity within the group via efficient transversal CNOT gates. Compared to standard lattice surgery operations, this reduces both the overall qubit footprint and execution time, lowering the spacetime overhead needed for small-scale QEC circuits. We also explore the architecture's scalability. We look at using physical atom movement schemes and propose interleaved lattice surgery which allows an all-to-all connectivity between qubits in adjacent interleaved groups, creating a higher connectivity routing space for large-scale circuits. Using numerical simulations, we evaluate the total routing time of interleaved lattice surgery and atom movement for various circuit sizes. We identify a cross-over point defining intermediate-scale circuits where atom movement is best and large-scale circuits where interleaved lattice surgery is best. We use this to motivate a hybrid approach as devices continue to scale, with the choice of operation depending on the routing distance.
研究の動機と目的
- 中性原子アレイにおけるサーフェスコード量子誤り訂正（QEC）の空間時間的オーバーヘッドを、ハードウェアの能力と共同で設計することで低減すること。
- 標準的なラティスソークがルーティング用アーキテクチャを必要とし、実行時間とフットプリントを増加させるという制限を克服すること。
- トランスバーサルCNOTゲートを用いて、キュービットグループ内でのすべてのキュービット間接続を実現することで、誤り率を低下させ、リソースコストを削減すること。
- 大規模回路向けに、インターリーブドラティスソークと物理的原子移動を組み合わせたスケーラブルなルーティング戦略を設計すること。
- プログラムサイズとデバイスレベルのパrameterに基づいて、最適なルーティング戦略（原子移動対ラティスソーク）を特定すること。
提案手法
- トランスバーサルCNOTゲートによるグループ内すべてのキュービット間接続を実現できるように、4〜16個のインターリーブド論理キュービットグループでデバイスをタイル化すること。
- 隣接するインターリーブドグループ間で、改良されたラティスソークプロトコルを導入し、グループ間でのすべてのキュービット間接続を実現することで、より高い接続性を持つルーティング空間を形成すること。
- さまざまな回路サイズとレイアウトにおいて、原子移動とインターリーブドラティスソークの両方の合計ルーティング時間を評価するために数値シミュレーションを実施すること。
- 物理的測定時間、原子移動速度、実現可能なリードバーグ相互作用範囲（グループサイズを定義）といった重要なデバイスパラメータへの性能感受性を分析すること。
- 標準的、コンact、インターリーブドの3つのレイアウトを比較し、コンパクトレイアウトがルーティング用アーキテクチャと衝突を最小限に抑えること。
- 短距離操作には原子移動、長距離操作にはインターリーブドラティスソークを用いるハイブリッドルーティング戦略を採用し、約50プログラムキュービットのクロスオーバー点に基づく。
実験結果
リサーチクエスチョン
- RQ1中性原子アレイにおけるインターリーブド論理キュービットグループは、トランスバーサルCNOTゲートを用いてグループ内でのすべてのキュービット間接続を実現可能であり、ラティスソークと比較して論理的誤り率が低減するか？
- RQ2隣接するグループ間でのインターリーブドラティスソークは、大規模なサーフェスコード回路におけるルーティング時間を短縮する高接続性ルーティング空間を提供するか？
- RQ3合計計算時間の観点から、原子移動からインターリーブドラティスソークへの移行が最も最適となるプログラムサイズはどの程度か？
- RQ4測定時間や原子移動速度といったデバイスレベルのパラメータは、ルーティング戦略間のクロスオーバー点にどのように影響を与えるか？
- RQ5原子移動とインターリーブドラティスソークを組み合わせたハイブリッドルーティングアプローチは、空間時間的オーバーヘッドの観点から、標準的なラティスソークを上回る性能を発揮できるか？
主な発見
- インターリーブドグループ内でのトランスバーサルCNOTは論理的誤り率を低減させ、ルーティング用アーキテクチャの必要性を排除することで、近い将来のQEC実証のコストを低下させる。
- 約50論理キュービット未満のプログラムでは、中間回路での原子移動によるルーティングが、標準的なラティスソークよりも短い実行時間を達成し、優れた性能を示す。
- 約50論理キュービットを超えるプログラムでは、より高い接続性とルーティング衝突の低減により、インターリーブドラティスソークが標準的なラティスソークと比較して2倍〜5倍の計算時間の高速化を実現する。
- ルーティング用アーキテクチャを最小限に抑えるコンパクトレイアウトは、特にインターリーブドグループと組み合わせた場合、計算時間の相対的改善が最大となる。
- 物理的測定時間の向上または原子移動速度の向上により、クロスオーバー点はそれぞれより小さなまたはより大きなプログラムサイズにシフトするため、デバイス性能に敏感であることが示された。
- 9より大きなインターリーブドグループサイズに拡大しても効果の増加は小さくなるため、最適性能を発揮するには9が実用的な上限であると考えられる。
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このレビューはAIが作成し、人間の編集者が確認しました。