[論文レビュー] Scaling silicon-based quantum computing using CMOS technology: State-of-the-art, Challenges and Perspectives
本論文は、補完的金属酸化膜半導体（CMOS）技術を用いて、量子層、インターフェース層、古典層のすべてのシステム層を統合することで、シリコンベースの量子コンピューティングのスケーリングを提案する。標準的な半導体プロセスを用いて、長寿命のコherences時間と高精度の制御を有するシリコン量子ビットを製造可能であることを実証し、1つのチップ上に完全統合可能なコンact、スケーラブルでコスト効率の良いフォールトトレランス型量子プロセッサの実現を可能にする。
Complementary metal-oxide semiconductor (CMOS) technology has radically reshaped the world by taking humanity to the digital age. Cramming more transistors into the same physical space has enabled an exponential increase in computational performance, a strategy that has been recently hampered by the increasing complexity and cost of miniaturization. To continue achieving significant gains in computing performance, new computing paradigms, such as quantum computing, must be developed. However, finding the optimal physical system to process quantum information, and scale it up to the large number of qubits necessary to build a general-purpose quantum computer, remains a significant challenge. Recent breakthroughs in nanodevice engineering have shown that qubits can now be manufactured in a similar fashion to silicon field-effect transistors, opening an opportunity to leverage the know-how of the CMOS industry to address the scaling challenge. In this article, we focus on the analysis of the scaling prospects of quantum computing systems based on CMOS technology.
研究の動機と目的
- プロトタイプデバイスを超えた量子コンピューティングシステムのスケーリングという重要な課題に、CMOS技術を用いてすべての層を統合することで対処する。
- 量子と古典の電子回路を1チップ上に統合することで、分散型の量子-古典システムの限界を克服する。
- 既存のVLSIプロセス技術とシリコンの長寿命コherences時間の利点を活用することで、大規模なフォールトトレランス型量子コンピューティングを実現する。
- コンactで製造可能なCMOSベースの量子プロセッシングユニットを活用し、マルチコアNISQプロセッサとハイブリッド量子-古典アルゴリズムの開発を促進する。
- マルチプロジェクトウェーパー（MPW）サービスと設計ルールの標準化を通じて、世界中へのシリコン量子デバイスへのアクセスを促進し、研究開発の加速を図る。
提案手法
- 量子コンピューティングシステムを3層に分解する：量子層（量子ビット）、量子-古典インターフェース（制御/読み出し）、古典層（デジタル/アナログ処理）。
- イソトープでドーピングされた28Siを用いた量子ドットまたはドーパー系のシリコンスピン量子ビットを採用し、長寿命コherences時間（T₂ > 20 ms）を達成する。
- 初期化および読み出しにスピンから電荷への変換を用い、1量子ビット操作には電子スピン共鳴を用いて高精度の制御を実現する。
- シリコンMOSまたはSi/SiGeヘテロ構造におけるゲートで定義されたポテンシャル制御を用いて、スピンの共鳴的シャッフルを実現し、量子ビット間の接続性と交換基盤の2量子ビットゲートを可能にする。
- 高インピーダンス共振器を用いたキャビティ媒介結合を検討し、高い共鳴結合率を有する長距離量子ビット相互作用を実現する。
- 研究志向のプロセスから標準的なシリコンファブリケーションに移行する方針を提示し、プロトタイプ開発を加速する柔軟なマルチプロジェクトウェーパー（MPW）サービスと標準化を推進する。
実験結果
リサーチクエスチョン
- RQ1量子層、インターフェース層、古典層のすべてが、CMOS技術を用いて統合可能か？
- RQ2既存のVLSIインfraストラクチャを用いて、シリコンスピン量子ビットをフォールトトレランスレベルまでスケーリングするにあたり、主なエンジニアリング的課題は何か？
- RQ3イソトープドーピングとデバイス工学を用いて、シリコンベースの量子ビットのコherences時間とゲート精度を最適化するにはどうすればよいか？
- RQ4CMOS準拠のスピンシャッフルとキャビティ媒介結合が、スケーラブルな量子ビット接続性を実現するために果たす役割は何か？
- RQ5産業規模のCMOSプロセスラインは、大規模なシリコン量子プロセッサの開発を支援するために、どのように適合可能か？
主な発見
- イソトープでドーピングされた28Siにおいて、電子スピンのコherences時間（T₂）が20 msを超えることが達成され、シリコンは固体系の中で最も高いコherences性を示す。
- シリコン量子ドットにおいて、高精度のスピンから電荷への変換と共鳴的1量子ビット操作が実証され、精度は99.4％に近い。
- 隣接する量子ドット間での共鳴的スピンシャッフルが、マイクロメーター規模の距離で平均99.4％の精度で達成された。
- 産業プロセスで製造されたデュアル量子ドットにおいて、単一スピンとマイクロ波光子間の大きな共鳴結合率が観測され、キャビティ媒介2量子ビットゲートの可能性が示された。
- 理論的および実験的結果から、CMOS準拠のプロセスは、サーフェスコードベースのフォールトトレランスに必要な数百万個の物理的量子ビットの統合を可能にする。
- 設計ルールを緩和したグローバルなマルチプロジェクトウェーパー（MPW）サービスを整備すれば、シリコン量子回路の開発と標準化を顕著に加速できる。
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このレビューはAIが作成し、人間の編集者が確認しました。